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IP-BCH1Pc-(n,k) Encoder / Decoder

IP-BCH1Pc-(n,k) は、 IP-BCH1P ファミリの BCH Code Encoder/Decoder IP Core で、消失訂正機能の不要なアプリケーション向けに、アーキテクチャを最適化したものです。

アーキテクチャ

IP-BCH1Pc-(n,k) では、パイプライン&パラレル処理を採用することで、高速な1シンボル1ビット BCH Code Encoder/Decoder IP Core を実現しております。また、消失訂正機能を省略して、回路規模を抑えています。消失訂正機能の不要なアプリケーションには、IP-BCH1Pc-(n,k) が適しています。


ピンアウト

ベンチマーク

型番

Xilinx X2V1000-6 による Encoder の実装

スライス数
ブロックRAM数動作速度
IP-BCH1P4610243 MHz
IP-BCH1P6770219 MHz
IP-BCH1P8930214 MHz
IP-BCH1P101050201 MHz
IP-BCH1P161480187 MHz
IP-BCH1P201790

182 MHz

IP-BCH1P322290182 MHz
※データ速度(平均) = 動作速度×(k/n)

型番Xilinx X2V1000-6 による Decoder の実装
スライス数 ブロックRAM数 動作速度
IP-BCH1P46431183 MHz
IP-BCH1P68501179 MHz
IP-BCH1P81,0761174 MHz
IP-BCH1P101,3081168 MHz
IP-BCH1P161,8401159 MHz
IP-BCH1P202,3381155 MHz
IP-BCH1P324,0511147 MHz
※データ速度(平均) = 動作速度×(k/n)

データシート

IP-BCH1Pc-(n,k) データシート
IP-BCH1Pc-(n,k) のデータシートはこちらからダウンロードできます。詳細については、データシートをご覧ください。

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