IP-V-SCR-IESS308 IP-V Series Intelsat Scrambler
本製品 IP-V-SCR-IESS308 は、Intelsat Earth Station Standards (IESS) Document IESS-308 (Rev.10), “Performance Characteristics for Intermediate Data Digital Carriers Using Convolutional Encoding /Viterbi Encoding and QPSK Modulation (QPSK/IDR)”, Page 70 で規定されている自己同期型スクランブラと、同 IESS-308 (Rev.10) Page H-22 で規定されている同期型スクランブラのセットです。
なお、以下では、自己同期型スクランブラ（self-synchronizing scrambler） の型番・ユニット名を IP-V-SCR-IESS308SS とし、同期型スクランブラ（synchronous scrambler）の型番・ユニット名を単にIP-V-SCR-IESS308 とします。
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アーキテクチャ
自己同期型スクランブラ（self-synchronizing scrambler） IP-V-SCR-IESS308SS の内部構造は次の通りです
同期型スクランブラ（synchronous scrambler）の内部構造は次の通りです。
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ピンアウト
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ベンチマーク
- Xilinx 社 Vertex シリーズによる IP-V-SCR-IESS308SS の実装
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デバイス
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スライス数
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ブロックRAM数
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動作速度
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| Vertex2 XC2V 1000-6 | 24 | 0 | 354 MHZ |
- Xilinx 社 Vertex シリーズによる IP-V-SCR-IESS308 の実装
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デバイス
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スライス数
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ブロックRAM数
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動作速度
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| Vertex2 XC2V 1000-6 | 13 | 0 | 502 MHZ |
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データシート
IP-V-SCR-IESS308 データシート
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